अमूर्त

Design of Low Power Dual Edge Triggered Flip Flop Based On Signal Feed through Scheme

S.Sujatha, M.Vignesh, V.Govindaraj

A low power dual edge triggered flip flop based on a signal feed through scheme is presented. The power consumption is the major problem in circuit design. The proposed deign reduces power and delay compared to explicit pulse triggered flip flop. Reducing the number of transistor in the stack and increasing the number of charge path leads to higher operational speed compared to others flip-flops. Double-edge-triggered flip flops (DETFFs) are recognized as power-saving flip flops. The dual edge triggered design operates in a low voltage range and hence it is suited for low voltage application. This flip flop uses weak feedback transistor but without static power consumption. This reduces leakage current and thus saves the power. By using low clock frequency high throughput can be achieved. The simulation is done using Tanner EDA Tool v14 with CMOS 90nm technology.

अस्वीकृति: इस सारांश का अनुवाद कृत्रिम बुद्धिमत्ता उपकरणों का उपयोग करके किया गया है और इसे अभी तक समीक्षा या सत्यापित नहीं किया गया है।

जर्नल हाइलाइट्स

अंकीय संकेत प्रक्रिया अतुल्यकालिक संकलन अधोचालकसंचालन अनुकूली संकेत संकेत अलग नेटवर्किंग आर्टिफ़िशियल क्लिनिक और इलेक्ट्रिकल में इलेक्ट्रिक ड्राइवर और उत्पाद इलेक्ट्रॉनिक सामग्री इलेक्ट्रॉनिक्स में आर्टिफिशियल ब्यूरो उपग्रह संचार एपीसैन निदान एवं संवेदन प्रणाली नियंत्रण सिद्धांत और सिद्धांत पावर इलेक्ट्रॉनिक कन्वर्टर्स का विश्लेषण बायो इलेक्ट्रॉनिक्स बिजली की गुणवत्ता और आपूर्ति की लागत के आर्थिक मूल्यांकन बेसिक इलेक्ट्रिकल इंजीनियरिंग भार एवं विद्युत पावर प्लांट की विद्युत एवं औषधि उपयोगिताएँ विद्युतचुंबकीय क्षणिक कार्यक्रम (ईएमआई) विद्युतीकरण

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